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奇怪,SMP類型的機(jī)器為什么能提高性能呢? [復(fù)制鏈接]

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1 [收藏(0)] [報(bào)告]
發(fā)表于 2010-01-07 09:07 |只看該作者 |倒序?yàn)g覽
大家都知道,機(jī)器處理的瓶頸在于內(nèi)存的速度,而不是cpu的速度
(內(nèi)存的速度和cpu的速度差數(shù)個數(shù)量級)

且SMP多處理器環(huán)境下,多個cpu訪問內(nèi)存時,都是要鎖總線的(也就是說,
內(nèi)存訪問在硬件級別總是串行的,多cpu訪問內(nèi)存和單cpu訪問內(nèi)存幾乎沒
啥區(qū)別,由于某些同步操作反而可能更慢)

那么,在如上兩個條件的約束下,SMP計(jì)算機(jī)經(jīng)常能提供比單CPU機(jī)器高大致
cpu個數(shù)倍的性能是怎么回事呢??

難道是由于cpu的一級緩存多了?比如,同主頻的cpu,單cpu的一級緩存是2MB
而2個cpu的SMP機(jī)器兩個cpu就是2MB*2=4MB??

還是其它什么決定性因素呢?

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2 [報(bào)告]
發(fā)表于 2010-01-07 09:30 |只看該作者
SMP的服務(wù)器,一般在每個核心內(nèi)部,都會集成一個內(nèi)存控制器,因此,訪問內(nèi)存的帶寬遠(yuǎn)遠(yuǎn)大于單個CPU時的帶寬。
另外,你說的緩存也是一個因素,但更重要的是二級緩存。一級緩存的容量太。ㄖ噶罹彺婧蛿(shù)據(jù)緩存一般都不超過64K)。

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3 [報(bào)告]
發(fā)表于 2010-01-07 09:37 |只看該作者
前端呀 前端

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4 [報(bào)告]
發(fā)表于 2010-01-07 11:17 |只看該作者
SMP 的機(jī)器,內(nèi)存不是多通道的么?

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5 [報(bào)告]
發(fā)表于 2010-01-07 12:18 |只看該作者
主要還是多進(jìn)程的程序,性能提高明顯吧。
編譯的時候加個-jn 估計(jì)很能說明問題。

要是在SMP上跑單進(jìn)程(線程)的程序,感覺不到什么的。

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6 [報(bào)告]
發(fā)表于 2010-01-11 10:36 |只看該作者
原帖由 drowndog 于 2010-1-7 09:30 發(fā)表
SMP的服務(wù)器,一般在每個核心內(nèi)部,都會集成一個內(nèi)存控制器,因此,訪問內(nèi)存的帶寬遠(yuǎn)遠(yuǎn)大于單個CPU時的帶寬。
另外,你說的緩存也是一個因素,但更重要的是二級緩存。一級緩存的容量太。ㄖ噶罹彺婧蛿(shù)據(jù)緩存一 ...


按照ULK的說法,SMP環(huán)境下的內(nèi)存訪問也是嚴(yán)格串行的:

In multiprocessor systems, all CPUs usually share the same memory; this
means that RAM chips may be accessed concurrently by independent CPUs.
Because read or write operations on a RAM chip must be performed serially,
a hardware circuit called a memory arbiter is inserted between the bus and
every RAM chip. Its role is to grant access to a CPU if the chip is free
and to delay it if the chip is busy servicing a request by another processor.
... ...

----from《Understanding the Linux Kernel, 3rd Edition》:2.1. Memory Addresses

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日期:2015-03-04 09:56:11數(shù)據(jù)庫技術(shù)版塊每日發(fā)帖之星
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7 [報(bào)告]
發(fā)表于 2010-01-11 10:40 |只看該作者
訪問一下地址,計(jì)算機(jī)就要去讀一下外部RAM,特別是DRAM的話,那計(jì)算機(jī)就是蝸牛速了

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8 [報(bào)告]
發(fā)表于 2010-01-11 10:42 |只看該作者
“前面已經(jīng)說過,雙通道內(nèi)存主要是依靠主板北橋的控制技術(shù),與內(nèi)存本身無關(guān)。因此如果
要使用支持雙通道內(nèi)存技術(shù)的話主板才是關(guān)鍵。目前支持雙通道內(nèi)存技術(shù)的主板有Intel
的i865和i875系列、SIS的SIS655、658系列、nVIDIAD的nFORCE2系列等。Intel最先推出
的支持雙通道內(nèi)存技術(shù)的芯片組為E7205和E7500系列!
----如上內(nèi)容摘自: http://zhidao.baidu.com/question/85081982.html

雙通道或者多通道內(nèi)存控制器好像是主板上的一個硬件吧?

假設(shè)同主頻,同1,2級緩存的單cpu和雙cpu,訪問同一個主板上的雙通道或者多通道內(nèi)存
那么這時的SMP還有優(yōu)勢嗎?

[ 本帖最后由 redac 于 2010-1-11 10:49 編輯 ]

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9 [報(bào)告]
發(fā)表于 2010-01-11 10:45 |只看該作者
“雙通道DDR有兩個64bit內(nèi)存控制器,雙64bit內(nèi)存體系所提供的帶寬等同于一個128bit
內(nèi)存體系所提供的帶寬,但是二者所達(dá)到效果卻是不同的。雙通道體系包含了兩個獨(dú)立的、
具備互補(bǔ)性的智能內(nèi)存控制器,兩個內(nèi)存控制器都能夠在彼此間零等待時間的情況下同時
運(yùn)作。例如,當(dāng)控制器B準(zhǔn)備進(jìn)行下一次存取內(nèi)存的時候,控制器A就在讀/寫主內(nèi)存,反之
亦然。兩個內(nèi)存控制器的這種互補(bǔ)“天性”可以讓有效等待時間縮減50%,雙通道技術(shù)使內(nèi)存
的帶寬翻了一翻!

----如上內(nèi)容摘自: http://zhidao.baidu.com/question/85081982.html

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10 [報(bào)告]
發(fā)表于 2010-01-14 13:19 |只看該作者
RTL8139網(wǎng)卡驅(qū)動程序分析

一文的第一章中提到: 新的集成內(nèi)存控制器的cpu可以自己判斷對內(nèi)存
的尋址

看來,內(nèi)存控制器可能在主板上,也可能在cpu內(nèi)部,兩個地方啊
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